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Triple PCI Express, Hot-Plug Controllers
14   ______________________________________________________________________________________
5礎
12S_-
12G_
12S_+
54mV
108mV
R
SENSE
150礎
1
0
?/DIV>
A
1
0
0
?/DIV>
A
-
+
-
+
10礎
120mA
5礎
3.3S_-
3.3G_
3.3S_+
20mV
40mV
150礎
3.3AUXO
PRES-DET_
FON_
AUXON_
UVLO
V
REF
ON_
R
SENSE
-
+
-
+
10礎
150mA
CHARGE
PUMP
-
+
R
TIM
TIM
IN    OUT    12VIN
PWRGD_
FAULT_
R
PORADJ
PORADJ
DEBOUNCE
FAST
OSCILLATOR
CONTROL LOGIC
MAIN-CHANNEL
CONTROL LOGIC
AUX-CHANNEL
INPUT COMPARATOR AND
CHIP CONTROL LOGIC
t
FAULT
t
POR
OSCILLATOR
MAX5957
BIAS, REFERENCES,
AND UVLO
CONTROL LOGIC
MAIN-CHANNEL
CONTROL LOGIC
AUX-CHANNEL
CHARGE
PUMP
100礎
Figure 1. Single-Channel Internal Block Diagram
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